基于单FPGA的可伸缩高速IP查找设计

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基于单FPGA的可伸缩高速IP查找设计增强出版
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FPGA based Highly Efficient and Scalable IP Lookup

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现今对IP查找的解决策略中,很少同时考虑了经济性和有效性.本文提供了一个经济有效:基于FPGA(现场可编程序门阵列)而且可伸缩(scalable)的设计.通过扩展内部的快速IP查找引擎,可以保证在最差情况下每秒20,000,000次查找,平均情况下每秒36,231,002次.实验模拟所用的路由表信息来自于Mae West的路由表快照.

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袁晶,陆颖迪.基于单FPGA的可伸缩高速IP查找设计.计算机系统应用,2004,13(9):36-39

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